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深圳市伟瑞电子有限公司
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石英晶体，有天然的也有人造的，是一种重要的压电晶体材料。石英晶体本身并非振荡器，它只有借助于有源激励和无源电抗网络方可产生振荡。SPXO主要是由品质因数（Q）很高的晶体谐振器（即晶体振子）与反馈式振荡电路组成的。石英晶体振子是振荡器中的重要元件，晶体的频率（基频或n次谐波频率）及其温度特性在很大程度上取决于其切割取向。石英晶体谐振器的基本结构、（金属壳）封装及其等效电路。只要在晶体振子板极上施加交变电压，就会使晶片产生机械变形振动，此现象即所谓逆压电效应。当外加电压频率等于晶体谐振器的固有频率时，就会发生压电谐振，从而导致机械变形的振幅突然增大。
石英钟走时准、耗电省、经久耐用为其大优点。不论是老式石英钟或是新式多功能石英钟都是以石英晶体振荡器为核心电路，其频率精度决定了电子钟表的走时精度。其中V1和V2构成CMOS反相器石英晶体Q与振荡电容C1及微调电容C2构成振荡系统，这里石英晶体相当于电感。振荡系统的元件参数确定了振频率。一般Q、C1及C2均为外接元件。另外R1为反馈电阻，R2为振荡的稳定电阻，它们都集成在电路内部。故无法通过改变C1或C2的数值来调整走时精度。但此时仍可用加接一只电容C有方法，来改变振荡系统参数，以调整走时精度。根据电子钟表走时的快慢，调整电容有两种接法：若走时偏快，则可在石英晶体两端并接电容C。此时系统总电容加大，振荡频率变低，走时减慢。若走时偏慢，则可在晶体支路中串接电容C。此时系统的总电容减小，振荡频率变高，走时增快。只要经过耐心的反复试验，就可以调整走时精度。因此，晶振可用于时钟信号发生器。
晶振在电气上可以等效成一个电容和一个电阻并联再串联一个电容的二端网络，电工学上这个网络有两个谐振点，以频率的高低分其中较低的频率为串联谐振，较高的频率为并联谐振。由于晶体自身的特性致使这两个频率的距离相当的接近，在这个极窄的频率范围内，晶振等效为一个电感，所以只要晶振的两端并联上合适的电容它就会组成并联谐振电路。这个并联谐振电路加到一个负反馈电路中就可以构成正弦波振荡电路，由于晶振等效为电感的频率范围很窄，所以即使其他元件的参数变化很大，这个振荡器的频率也不会有很大的变化。晶振有一个重要的参数，那就是负载电容值，选择与负载电容值相等的并联电容，就可以得到晶振标称的谐振频率。一般的晶振振荡电路都是在一个反相放大器（注意是放大器不是反相器）的两端接入晶振，再有两个电容分别接到晶振的两端，每个电容的另一端再接到地，这两个电容串联的容量值就应该等于负载电容，请注意一般IC的引脚都有等效输入电容，这个不能忽略。一般的晶振的负载电容为15p或12.5p，如果再考虑元件引脚的等效输入电容，则两个22p的电容构成晶振的振荡电路就是比较好的选择。
如何防止晶振出现不良现象，现在介绍严格按照技术要求的规定，对晶振组件进行检漏试验以检查其密封性，具体如下：
1、压封工序是将调好的谐振件在保护中与外壳封装起来，以稳定石英晶体谐振器的电气性能。在此工序应保持送料仓、压封仓和出料仓干净，压封仓要连续冲，并在压封过程中注意焊头磨损情况及模具位置，电压、气压和流量是否正常，否则及时处理。其质量标准为：无伤痕、毛刺、顶坑、弯腿，压印对称不可歪斜。
2、由于石英晶体是被动组件，它是由IC提供适当的激励功率而正常工作的，因此，当激励功率过低时，石英晶振不易起振，过高时，便形成过激励，使石英芯片破损，引起停振。所以，应提供适当的激励功率。另外，有功负载会消耗一定的功率，从而降低晶体Q值，从而使晶体的稳定性下降，容易受周边有源组件影响，处于不稳定状态，出现时振时不振现象，所以，外加有功负载时，应匹配一个比较合适有功负载。
3、控制好剪脚和焊锡工序，并保证基座绝缘性能和引脚质量，引脚镀层光亮均匀无麻面，无变形、裂痕、变色、划伤、污迹及镀层剥落。为了更好地防止单漏，可以在晶体下加一个绝缘垫片。
4、当晶体产生频率漂移而且超出频差范围时，应检查是否匹配了合适的负载电容，可以通过调节晶体的负载电容来解决。
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